微算機8086/8088 bus cycle的問題???

微算機 8086/8088 bus cycle的問題?

if the CLK input to the 8086/8088 is 4MHz , how long is one bus cycle?

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  • EJ
    Lv 7
    1 decade ago
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    所謂的 CLK 是電腦作動的一個基本時脈. 電腦的元件, 有的快, 有的慢. 如果大家步調不一, 那麼快的送出資料後, 慢的還來不及接收, 快的就又再送資料出來, 那麼慢的就會來不及接收, 搞到天下大亂. 所以就有 CLK, 以及 bus cycle. CLK 是一個一個的柱狀時脈波, 大家在時脈波上揚時才同步作接或收的動作. 比較快的元件, 也許在一個 CLK 之內就可以完成, 但是比較慢的元件, 就要幾個 CLK 才能完成動作. 快的就是要等慢的. 至於 bus, 通常有 data bus (資料)、address bus (位址)及 command bus (命令) 三種. bus cycle 應該是指 data bus 的 cycle time. 8086 需要 4 個 CLK 去完成一個 bus cycle. (請參考 http://www.cs.umbc.edu/~plusquel/310/slides/8086_c... bus timing 的部分)

    CLK 如果是 4MHz, 所以一個 CLK cycle 就是 250 ns (nano second). 一個 bus cycle 需要 4 個 CLK, 那麼一個 bus cycle 就是 1000 ns.

    如果題目中有指明一個 bus cycle 是 3T 或 6T, 而非 4T, 那麼 bus cycle time 就要改成 750 ns 及 1500 ns 了. 我記得 read 跟 write 的 cycle 是不一樣的, 好像是 4T 和 6T, 但是又不大確定.

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